chipsalliance/verible
View on GitHubVerible is a suite of SystemVerilog developer tools, including a parser, style-linter, formatter and language server
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package management
chipsalliance/verible#1 · 4 comments · 1 reaction · 0 assignees ·
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GNU autotools build Openbuild system enhancement
chipsalliance/verible#4 · 0 comments · 2 reactions · 1 assignee ·
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chipsalliance/verible#15 · 2 comments · 0 reactions · 0 assignees ·
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formatter
chipsalliance/verible#28 · 4 comments · 1 reaction · 1 assignee ·
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formatter
chipsalliance/verible#33 · 3 comments · 0 reactions · 0 assignees ·
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formatter
chipsalliance/verible#36 · 7 comments · 0 reactions · 0 assignees ·
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chipsalliance/verible#71 · 0 comments · 0 reactions · 1 assignee ·
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chipsalliance/verible#76 · 0 comments · 0 reactions · 0 assignees ·
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question
chipsalliance/verible#92 · 1 comment · 0 reactions · 0 assignees ·
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formatter
chipsalliance/verible#96 · 2 comments · 0 reactions · 0 assignees ·
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preprocessor
chipsalliance/verible#102 · 9 comments · 0 reactions · 0 assignees ·
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enhancement style-linter
chipsalliance/verible#141 · 2 comments · 0 reactions · 0 assignees ·
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rejects-valid syntax
chipsalliance/verible#149 · 1 comment · 0 reactions · 0 assignees ·
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code health help wanted
chipsalliance/verible#159 · 0 comments · 0 reactions · 0 assignees ·
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formatter question
chipsalliance/verible#160 · 4 comments · 1 reaction · 0 assignees ·
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VHDL Support Openenhancement help wanted
chipsalliance/verible#174 · 1 comment · 0 reactions · 0 assignees ·
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code health formatter
chipsalliance/verible#181 · 1 comment · 0 reactions · 1 assignee ·
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help wanted preprocessor
chipsalliance/verible#183 · 0 comments · 7 reactions · 0 assignees ·
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help wanted
chipsalliance/verible#184 · 2 comments · 0 reactions · 0 assignees ·
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documentation formatter help wanted
chipsalliance/verible#191 · 0 comments · 1 reaction · 0 assignees ·
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code health
chipsalliance/verible#208 · 2 comments · 0 reactions · 1 assignee ·
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style-linter
chipsalliance/verible#217 · 3 comments · 7 reactions · 0 assignees ·
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preprocessor
chipsalliance/verible#221 · 3 comments · 0 reactions · 0 assignees ·
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preprocessor
chipsalliance/verible#228 · 6 comments · 0 reactions · 0 assignees ·
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enhancement help wanted preprocessor
chipsalliance/verible#241 · 2 comments · 0 reactions · 0 assignees ·
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formatter
chipsalliance/verible#251 · 8 comments · 0 reactions · 0 assignees ·
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enhancement style-linter
chipsalliance/verible#257 · 4 comments · 0 reactions · 0 assignees ·
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lexer: preserve encrypted text as tokens, filter them from lint analysis, preserve for formatting Open
chipsalliance/verible#259 · 1 comment · 0 reactions · 1 assignee ·
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preprocessor rejects-valid syntax
chipsalliance/verible#267 · 4 comments · 0 reactions · 0 assignees ·
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chipsalliance/verible#269 · 1 comment · 0 reactions · 0 assignees ·
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rejects-valid syntax
chipsalliance/verible#270 · 2 comments · 0 reactions · 0 assignees ·
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formatter
chipsalliance/verible#275 · 1 comment · 0 reactions · 0 assignees ·
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documentation
chipsalliance/verible#279 · 3 comments · 0 reactions · 0 assignees ·
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style-linter
chipsalliance/verible#286 · 1 comment · 0 reactions · 0 assignees ·
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enhancement integration style-linter
chipsalliance/verible#291 · 4 comments · 0 reactions · 0 assignees ·
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enhancement formatter integration
chipsalliance/verible#292 · 3 comments · 0 reactions · 0 assignees ·
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style-linter
chipsalliance/verible#303 · 6 comments · 0 reactions · 0 assignees ·
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enhancement style-linter
chipsalliance/verible#310 · 4 comments · 0 reactions · 1 assignee ·
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style-linter
chipsalliance/verible#316 · 2 comments · 0 reactions · 0 assignees ·
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help wanted integration
chipsalliance/verible#317 · 11 comments · 0 reactions · 0 assignees ·
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formatter
chipsalliance/verible#320 · 2 comments · 0 reactions · 0 assignees ·
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formatter
chipsalliance/verible#321 · 2 comments · 0 reactions · 0 assignees ·
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formatter
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formatter
chipsalliance/verible#328 · 3 comments · 0 reactions · 0 assignees ·
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formatter
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help wanted integration
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formatter
chipsalliance/verible#346 · 3 comments · 1 reaction · 0 assignees ·