AntonioBerna / AntonioBerna/ciotto
HDL Design 🔌
未關閉
enhancement
good first issue
- 主要語言
- C
- 星號
- 0
- 分支
- 0
- PR 合併指標
- 30 天內沒有已合併 PR
描述
Create an HDL description of CHIP-8 for FPGA board using VHDL, Verilog and SystemVerilog.
貢獻指南
這個儲存庫沒有索引到貢獻指南
評估
這個 Issue 還沒有評估資料。